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        1、培訓過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、課程完成后,授課老師留給學員手機和Email,保障培訓效果,免費提供半年的技術支持。
        3、培訓合格學員可享受免費推薦就業(yè)機會。

　Virtuoso Layout Editor是Cadence 功能強大的全定制數(shù)字和模擬IC版圖編輯器。新型的強大的命令集同先進的版圖編輯技術相結(jié)合，使其支持純多邊形、參數(shù)化單元、符號化版圖與壓縮、版圖綜合等多種輸入方法，快速的設計層次瀏覽以及多窗口環(huán)境使用戶可同時編輯多個設計。Assura物理驗證系統(tǒng)與Virtuoso無縫集成，組成完整的在線版圖設計和驗證環(huán)境。Virtuoso是廣泛用于世界頂尖的半導體廠商標準的設計環(huán)境。
　　 Assura系列產(chǎn)品是面向深亞微米IC設計(<0.25um)的版圖驗證、參數(shù)提取的新解決方案，可用批處理或交互式模式對GDSII或Cadence的DFII數(shù)據(jù)庫進行驗證。Assura使用了層次化處理方法，為設計者提供了容量、性能、特征和精度等方面的突出性能，可滿足全芯片驗證的需要。Assura系列產(chǎn)品就為深亞微米模擬和混合信號設計提供了佳完整的從前端到后端解決方案。通過與業(yè)界使用廣泛的模擬電路設計環(huán)境（DFII, ADE、VLE等）緊密集成在一起，Assura已經(jīng)成為今天和將來全定制電路設計的佳選擇。

課程安排: Virtuoso Layout Editor & Assura Physical Verification (day 1-2)
階段 1:
Introduction
The Layout Editor Environment??
Layout Editor Basics
The Layout Editor Environment (Lab1)
The Layout Editor Commands (Lab2)
Layout Editor Basics (Lab3)

階段 2 :
Creating and Editing?DESIGNS
Virtuoso Layout Editor Turbo
Assura Physical Verification (DRC LVS)
Creating and Editing?DESIGNS?(Lab4)
Virtuoso Layout Editor Turbo (Lab5)
Assura Physical Verification (Lab6)